Consultar: Faculdade de Engenharia Elétrica e de Computação - FEEC

Título [Principal]: Remoção do jitter, introduzido pelo recheio, em sistemas MCP de 2a. ordem
Autor(es): Luiz Augusto Castrillon de Aquino
Palavras-chave [PT]:

Comunicações digitais , Multiplexação , Telecomunicações
Titulação: Mestre em Engenharia Elétrica
Banca:
Helio Waldman [Orientador]
Resumo:
Resumo: Um sistema de MCP de 2a. ordem, consiste na multiplexação de 4 sistemas MCP de 1a. ordem, como esses 4 sistemas são assincronos, plesiocronos e necessário coloca-los numa frequência comum. Uma tecnica utilizada para esse fim e a chamada tecnica - de justificação, ou recheio (stuffing) que consiste em adicionar ou retirar pulsos, no trem de pulsos de cada sistema de 1a. ordem. Esse processo gera um jitter característico, denominado, jitter de tempo de espera, que ocorre pelo fato da adição, ou retirada, de pulsos não acontecerem nos momentos necessarios, porem nos momentos adequados. Esse tipo de jitter possue uma componente de baixa e outra de alta frequência. A componente de alta frequência pode ser perfeitamente filtrada por um oscilador de fase controlada, conhecido na literatura como "PHASE LOCKED LOOP" do qual denominaremos a partir de então como P.L.L.Esse P.L.L., irá atuar na demultiplexagem tambem para gerar um relógio de leitura de da dos no demultiplex. Esse trabalho consiste no projeto desse P.L.L., que deverá ser usado no sistema MCP de 120 canais ora em desenvolvimento no Departamento de Engenharia Eletrica e Eletrônica da UNICAMP

Abstract: Not informed
Data de Defesa: 02-1977
Código: vtls000113870
Informações adicionais:
Idioma: Português
Data de Publicação: 1977
Local de Publicação: Campinas, SP
Orientador: Helio Waldman
Instituição: Universidade Estadual de Campinas . Faculdade de Engenharia Elétrica e de Computação
Nível: Dissertação (mestrado)
UNICAMP: Programa de Pós-Graduação em Engenharia Elétrica

Dono: admin
Criado: 20-06-2008 15:44
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